VHDL-AMS 시뮬레이션

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VHDL 시뮬레이션
Verilog 시뮬레이션
Verilog-A 및 AMS 시뮬레이션
SystemVerilog 시뮬레이션
SystemC 시뮬레이션

VHDL-AMS TINA에도 포함된 VHDL 하드웨어 설명 언어의 확장입니다. 그것은 포함 A아날로그와 M고정-S아날로그 및 혼합 신호 시스템을 시뮬레이션하기 위해 순수 디지털 VHDL 언어에 대한 AMS(ignal extensions). TINA의 Examples\HDL\VHDL-AMS 폴더에서 여러 회로 예제를 찾을 수 있습니다.