10 ။ FET Amplifier ဒီဇိုင်း
FET Amplifier ဒီဇိုင်း
ယခုကြှနျုပျတို့ FET ချဲ့စက်များ၏ဒီဇိုင်းကိုမှအစောပိုင်းကဤအခနျးတှငျပေးအပ်သည့် FET အသံချဲ့စက်ခွဲခြမ်းစိတ်ဖြာ၏ extension ကိုစူးစမ်း။ ကျနော်တို့ဒီဇိုင်းပြဿနာအတွက်မသိသတ်မှတ်ကြိုးစား, ပြီးတော့သည်ဤမသိများအတွက်ဖြေရှင်းဘို့ညီမျှခြင်းဖွံ့ဖြိုးတိုးတက်ပါလိမ့်မယ်။ အများဆုံးအီလက်ထရွန်နစ်ဒီဇိုင်း၌ရှိသကဲ့သို့, ညီမျှခြင်း၏နံပါတ်မသိ၏နံပါတ်ထက်လျော့နည်းဖြစ်လိမ့်မည်။ အဆိုပါအပိုဆောင်းသတ် (ကြောင့် parameter သည်အပြောင်းအလဲများကိုမှစွမ်းဆောင်ရည်အတွက်ဥပမာနိမ့်ဆုံးကုန်ကျစရိတ်လျော့နည်းအပြောင်းအလဲ) အချို့သောခြုံငုံရည်ရွယ်ချက်များနှင့်တွေ့ဆုံရန်ထူထောင်လျက်ရှိသည်။
10.1 အဆိုပါ CS Amplifier
တစ်ဦး CS အသံချဲ့စက်၏ဒီဇိုင်းကိုလုပ်ထုံးလုပ်နည်းဒီအခန်းမှာပေးအပ်သည်။ ကျနော်တို့အနေနဲ့စနစ်တကျလုပ်ထုံးလုပ်နည်းမှ JFET နှင့်ကွယ်ပျောက်သွား MOSFET အသံချဲ့စက်ဒီဇိုင်းကိုလျော့ချရလိမ့်မည်။ ဤထင်ရှားစေခြင်းငှါနေစဉ်
ဒီဇိုင်းကိုအလွန်လုပ်ရိုးလုပ်စဉ်ဖြစ်အောင်လျှော့ချပါ။ အဆင့်အမျိုးမျိုးအတွက်နောက်ဆက်တွဲလိုအပ်သောကြောင့်အဆင့်တစ်ခုချင်းစီ၏မူလအစကိုသင်နားလည်ကြောင်းသင်ကိုယ်တိုင်ယုံကြည်ရမည်။ CS amplifier ကိုဒီဇိုင်းလုပ်ရန်သင်လုပ်သမျှအားလုံးသည်ကျွန်ုပ်တို့တင်ပြသည့်အဆင့်များသို့မဆင်မခြင်“ plug in” လုပ်ရန်ဖြစ်လျှင်သင်ဤဆွေးနွေးမှု၏အချက်တစ်ချက်လုံးပျောက်ဆုံးနေသည်။ အင်ဂျင်နီယာတစ်ယောက်အနေနဲ့သင်ဟာအရာရာကိုလုပ်ဖို့ကြိုးစားနေတယ် မဟုတ် လုပ်ရိုးလုပ်စဉ်။ တစ်ခုစနစ်တကျချဉ်းကပ်ရန်သီအိုရီလျှော့ချသင်လုပ်နေပါလိမ့်မည်အရာဖြစ်တယ်။ သငျသညျရိုးရှင်းစွာအခြားသူတွေပြီးသားသင်တို့အဘို့ပွုပါပွီသည့်ချဉ်းကပ်မှုလျှောက်ထားမည်မဟုတ်။
Amplifiers များသည်အလိုအလျောက်ရရှိထားသောလိုအပ်ချက်များနှင့်ကိုက်ညီစေရန်ဒီဇိုင်းပြုလုပ်ထားပြီး Transistor ၏အကွာအဝေးတွင်ရှိသည်။ supply voltage, load ခုခံမှု၊ voltage gain နှင့် input ခုခံမှု (သို့မဟုတ် current gain) ကိုများသောအားဖြင့်သတ်မှတ်သည်။ ဒီဇိုင်နာ၏အလုပ်မှာခံနိုင်ရည်ရှိမှုတန်ဖိုးများကိုရွေးချယ်ရန်ဖြစ်သည် R1, R2, RDနှင့် RS။ သင်လုပ်ထုံးလုပ်နည်းအတွက်ခြေလှမ်းများကိုလိုက်နာအဖြစ်ပုံ 40 ရည်ညွှန်းကိုးကားပါ။ ဒါဟာလုပ်ထုံးလုပ်နည်းကိရိယာကိုရှေးခယျြနှင့်၎င်း၏ဝိသေသလက္ခဏာများလူသိများဖြစ်ကြောင်းသိရသည်ကြောင်းယူဆတယ်။
ပထမဦးစွာ FET ဝိသေသခါးဆစ်၏ရွှဲဒေသတွင်း၌တစ်ဦး Q-အမှတ်ကိုရွေးချယ်ပါ။ ဥပမာတစ်ခုအဘို့ပုံ 40 (ခ) ၏ခါးဆစ်ကိုကိုးကားပါ။ ဤသည် identifier VDSQ, VGSQနှင့် IDQ.
ကျနော်တို့အခု output ကိုကွင်းဆက်ထဲမှာနှစ်ခု resistors များအတွက်ဖြေရှင်း, RS နှင့် RD။ နှစ်ခုမသိရှိပါတယ်ကတည်းကကျနော်တို့နှစ်ဦးကိုလွတ်လပ်သောညီမျှခြင်းလိုအပ်သည်။ ကျနော်တို့ရေးသားခြင်းအားဖြင့်စတင် dc အဆိုပါယိုစီးမှု-source ကိုကွင်းဆက်န်းကျင် KVL ညီမျှခြင်း,
(58)
နှစ်ခု resistors အထွက်နှုန်း၏ပေါင်းလဒ်များအတွက်ဖြေရှင်း
(59)
(60)
အဆိုပါခုခံ, RD, ဒီညီမျှခြင်းအတွက်သာမသိရသည်။ မှုအတွက်ဖြေရှင်း RD နှစ်ခုဖြေရှင်းနည်းများ, အနုတ်လက္ခဏာများထဲမှနှင့်အပြုသဘောဆောင်သည့်တဦးတည်းရှိခြင်းတစ် quadratic ညီမျှခြင်းအတွက်ရလဒ်တွေကို။ အပြုသဘောဖြေရှင်းချက်အတွက်ရလဒ်များပါလျှင် RD > K1ဤသို့တစ်ဦးအနုတ်လက္ခဏာတွေ့ရှိခဲ့ရသည် RSအသစ်တစ်ခု Q-အမှတ် (ဆိုလိုသည်မှာ, ဒီဇိုင်းကို restart လုပ်ပါ) ကိုရွေးချယ်ရမည်ဖြစ်သည်။ အပြုသဘောဖြေရှင်းချက်အထွက်နှုန်းပါလျှင် RD < K1ကျနော်တို့ဆက်လက်ဆောင်ရွက်နိုင်ပါ။
အခုက RD လူသိများသည်, ငါတို့အဘို့အဖြေရှင်းပေး RS ညီမျှခြင်း (59), ပုယိုစီးမှု-to-source ကိုကွင်းဆက်ညီမျှခြင်းကိုသုံးနိုင်သည်။
(61)
နှင့် RD နှင့် RS လူသိများကျနော်တို့ကိုရှာဖွေမှသာလိုအပ်ပါတယ် R1 နှင့် R2.
ကျနော်တို့မြို့တံခါးဝ-source ကိုကွင်းဆက်တွေအတွက် KVL ညီမျှခြင်းပြန်ပြောင်းရေးခြင်းဖြင့်စတင်။
(62)
အဆိုပါဗို့အား, VGSကနေဆန့်ကျင်ဘက် polarity ကသည် VDD။ အရှင်ဝေါဟာရကို IDQRS ထက် သာ. ကြီးမြတ်ဖြစ်ရမည် VGSQ ပြင်းအားပါ။ ဒီလိုမှမဟုတ်ရင် VGG ကနေဆန့်ကျင်ဘက် polarity ကရပါလိမ့်မယ် VDD, ညီမျှခြင်း (62) အရမဖြစ်နိုင်ပါဖြစ်၏။
ယခုကြှနျုပျတို့အဘို့အဖြေရှင်းပေး R1 နှင့် R2 ယူဆသည့်ကြောင်း VGG အဆိုပါရှိပါတယ်တွေ့ရှိခဲ့ တူညီတဲ့ polarity က as VDD။ ဤရွေ့ကား resistor တန်ဖိုးများ၏တန်ဖိုးကိုရှာဖွေတာကရွေးချယ်နေကြတယ် RG လက်ရှိ-အမြတ်ညီမျှခြင်းကနေဒါမှမဟုတ် input ကိုခုခံခြင်းမှ။ ကျနော်တို့အဘို့အဖြေရှင်းပေး R1 နှင့် R2.
(63)
တစ်ဦးအတွက်ယခုကြောင်းညီမျှခြင်း (62) ရလဒ်များကိုဆိုပါစို့ VGG သောရှိပါတယ် ဆန့်ကျင်ဘက် polarity က of VDD။ ဒါဟာအဘို့အဖြေရှင်းပေးဖို့မဖြစ်နိုင်ပါ R1 နှင့် R2။ ဆက်လက်ဆောင်ရွက်ရန်လက်တွေ့ကျသောနည်းလမ်းတစ်ခုပါစေရန်ဖြစ်ပါသည် VGG ထို့ကြောင့် = 0 V. , ။ မှစ. VGG ညီမျှခြင်း (62) ၏ယခင်ကတွက်ချက်တန်ဖိုးသတ်မှတ်ထားသောဖြစ်ပါတယ် RS ယခုအချိန်တွင်နောက်ဆုံးပြင်ဆင်ခဲ့သည်ရန်လိုအပ်ပါသည်။
တစ်ဦးက Capacitor ၏အစိတ်အပိုင်းတစ်ခုကျော်လွှားရန်အသုံးပြုသည်အဘယ်မှာရှိပုံ 41 အတွက် RSကျနော်တို့၏တန်ဖိုးအသစ်ဖွံ့ဖြိုး RS အောက်မှာဖော်ပြထားတဲ့အတိုင်း:
(64)
၏တန်ဖိုး RSDC is RS1 + RS2 နှင့်၏တန်ဖိုး Rsac is RS1.
ယခုငါတို့အသစ်တခုရှိသည် RSDCကျနော်တို့ဒီဇိုင်းအများအပြားကိုအစောပိုင်းကခြေလှမ်းများပြန်လုပ်ရမည်ဖြစ်သည်။ ကျနော်တို့တစ်ဖန်ဆုံးဖြတ်ရန် RD အဆိုပါယိုစီးမှု-to-source ကိုကွင်းဆက်များအတွက် KVL ကိုသုံးနိုင်သည်။
(65)
အဆိုပါဒီဇိုင်းပြဿနာသည်ယခုအခါနှစ်ဦးစလုံးတွက်ချက်တစ်ဦးဖြစ်လာ RS1 နှင့် RS2 အစားတစ်ဦးတည်းသာအရင်းအမြစ် resistor ရှာတွေ့၏။
အသစ်တစ်ခုတန်ဖိုး RD of K1 - R ကိုSDCကျနော်တို့နှင့်အတူညီမျှခြင်း (60) ၏ဗို့အားအမြတ်စကားရပ်ကိုသွား Rsac ဒီအသုံး ac ညီမျှခြင်းထက် RS။ အောက်ပါအပိုဆောင်းခြေလှမ်းများဒီဇိုင်းလုပ်ထုံးလုပ်နည်းထည့်သွင်းရမည်ဖြစ်သည်:
ကျနော်တို့ကိုရှာဖွေ Rsac (ရိုးရိုးအရာ RS1) ကိုဗို့အားအမြတ်ညီမျှခြင်းကနေ
(66)
Rsac ဒီညီမျှခြင်းအတွက်သာမသိရသည်။ ဒီဖြေရှင်းရေး, ငါတို့ရှာတွေ့
(67)
ဆိုပါစို့အခု Rsac အပြုသဘောဆောင်ပေမယ်ထက်လျော့နည်းဖြစ်တှေ့ရှိရ၏ RSDC။ ဤသည်မှာကတည်းကနှစ်လိုဖွယ်အခြေအနေဖြစ်ပါသည်
(68)
ထိုအခါငါတို့ဒီဇိုင်းကိုပြီးပြည့်စုံသည်နှင့်
(69)
ကြောင်းဆိုပါစို့ Rsac အပြုသဘောဖြစ်တှေ့ရှိရ၏ပေမယ့် သာ. ကြီး ထက် RSDC။ ရွေးချယ်ထားသည့်အတိုင်းအသံချဲ့စက်ဟာဗို့အားအမြတ်နှင့် Q-အချက်နှင့်အတူဒီဇိုင်းမရနိုင်ပါ။ အသစ် Q-အမှတ်ကိုရွေးချယ်ရမည်ဖြစ်သည်။ အဆိုပါဗို့အမြတ်လည်းမြင့်မားသည်ဆိုပါကမည်သည့်အမေး-အချက်နှင့်အတူဒီဇိုင်းဖြစ်ပေါ်လာအောင်ဖြစ်နိုင်မည်မဟုတ်ပါ။ တစ်ဦးကကွဲပြားခြားနားကို transistor လိုအပ်မည်အကြောင်း, သို့မဟုတ်နှစ်ခုသီးခြားအဆင့်ဆင့်၏အသုံးပြုမှုကိုလိုအပ်နိုင်ပါသည်။
10.2 အဆိုပါ CD ကိုချဲ့ထွင်
ကျနော်တို့အခု CD ကို JFET အသံချဲ့စက်များအတွက်ဒီဇိုင်းကိုလုပ်ထုံးလုပ်နည်းကိုတင်ပြ။ အောက်ပါပမာဏသတ်မှတ်ထားသောနေကြသည်: လက်ရှိအမြတ်, ဝန်ခုခံနှင့် VDD။ input ကိုခုခံအစားလက်ရှိအမြတ်၏သတ်မှတ်ထားသောနိုင်ပါသည်။ အောက်ပါလုပ်ထုံးလုပ်နည်းကိုလေ့လာစဉ်ပုံ ၃၉ ရှိဆားကစ်ကိုကြည့်ပါ။ တစ်ဖန် ထပ်မံ၍ ကျွန်ုပ်တို့သည်သီအိုရီကိုအဆင့်ဆင့်အဖြစ်သို့လျှော့ချခြင်းဖြစ်စဉ်သည်အမှန်တကယ်အဆင့်များမဟုတ်ပါကဤဆွေးနွေးမှု၏အရေးကြီးသောအစိတ်အပိုင်းဖြစ်သည်ကိုကျွန်ုပ်တို့သတိရသည်။
ပထမ ဦး စွာပုံ ၂၀ (“ အခန်း ၃ - Junction field-effect transistor (JFET)”) ၏အကူအညီဖြင့် FET ဝိသေသ curves ၏အလယ်ဗဟိုရှိ Q-point ကို ဦး စွာရွေးချယ်ပါ။ ဤအဆင့်ကိုဆုံးဖြတ်သည် VDSQ, VGSQ, IDQ နှင့် gm.
ကျနော်တို့ရေးသားခြင်းအားဖြင့် source ကိုချိတ်ဆက် resistor များအတွက်ဖြေရှင်းလို့ရပါတယ် dc အဆိုပါယိုစီးမှု-to-source ကိုကွင်းဆက်န်းကျင် KVL ညီမျှခြင်း။
(70)
အရာထဲကနေကျနော်တို့ကရှာတွေ့ dc တန်ဖိုး RS,
(71)
ကျနော်တို့လာမယ့်ရှာတွေ့ ac ခုခံရေး၏တန်ဖိုးကို, Rsac, အပြန်စီစဉ်လက်ရှိအမြတ်ညီမျှခြင်းကနေအီကွေတာ (55) ။
(72)
ဘယ်မှာ RG = Rin. အဆိုပါ input ကိုခုခံမသတ်မှတ်ထားပါလျှင်ပါစေ Rsac = RSDC နှင့်ညီမျှခြင်း (72) ကနေ input ကိုခုခံတွက်ချက်။ အဆိုပါ input ကိုခုခံအလုံအလောက်မြင့်မားတဲ့မပါရှိလျှင်ကမေး-အမှတ်တည်နေရာကိုပြောင်းလဲရန်လိုအပ်သောဖြစ်နိုင်သည်။
If Rin သတ်မှတ်ထားသောတာဖြစ်ပါတယ်, ကတွက်ချက်ရန်လိုအပ်ပါသည် Rsac ညီမျှခြင်း (72) မှ။ ထိုကဲ့သို့သောကိစ္စများတွင် Rsac ကနေကွဲပြားခြားနားသည် RSDCဒါကြောင့်ကျနော်တို့၏တစ်စိတ်တစ်ပိုင်းကိုရှောင်ကွင်း RS တစ်ဦးက Capacitor အတူ။
ကျနော်တို့အခု input ကိုဘက်လိုက်မှု circuitry ကြှနျတျောတို့၏အာရုံကိုလှည့်။ ကျနော်တို့ဆုံးဖြတ်ရန် VGG ညီမျှခြင်းသုံးပြီး
(73)
အဘယ်သူမျှမအဆင့်ပြောင်းပြန်လှန်မယ့်အရင်းအမြစ်နောက်လိုက် FET အသံချဲ့စက်များတွင်ထုတ်လုပ်သည် VGG ပုံမှန်အားဖြင့်အဆိုပါထောက်ပံ့ရေးဗို့ကဲ့သို့တူညီသော polarity ကသည်။
အခုက VGG ကျနော်တို့၏တန်ဖိုးများကိုဆုံးဖြတ်ရန်, လူသိများသည် R1 နှင့် R2 အဆိုပါဘက်လိုက်မှု circuitry ၏ Thevenin ညီမျှထံမှ
(74)
အဆိုပါ JFET တံခါးဖြင့်လိုအပ်သောအနုတ်လက္ခဏာ voltages ကိုထေမိရန်လိုအပ်ကြောင်းဆန့်ကျင်ဘက် polarity ကဗို့အားဖွံ့ဖြိုးတိုးတက်ဖို့တစ်ခု SF အတွက်လုံလောက်အောင်ယိုစီးမှုကလက်ရှိအများအားဖြင့်ရှိပါသည်။ ထို့ကြောင့်, ပုံမှန်ဗို့ဌာနခွဲဘက်လိုက်မှုကိုအသုံးပြုနိုင်ပါတယ်။
ကျနော်တို့အခု input ကိုခုခံသတ်မှတ်ခြင်း၏ပြဿနာကိုပြန်သွားပါ။ ကျနော်တို့၏အစိတ်အပိုင်းတစ်ရပ်ယူဆနိုင်ပါတယ် RS ၏ကွဲပြားခြားနားသောတန်ဖိုးများကိုဦးတည်ထားတဲ့ပုံ 44, ၌ရှိသကဲ့သို့, ရှောင်ကွင်းဖြစ်ပါတယ် Rsac နှင့် RSDC။ ကျနော်တို့အဘို့ဖြေရှင်းနိုင်မှညီမျှခြင်း (71) ကိုသုံး RSDC။ Next ကိုကျနော်တို့ပါစေ RG ၏သတ်မှတ်ထားသောတန်ဖိုးကိုတူညီ Rinနှင့်အဘို့ဖြေရှင်းနိုင်မှညီမျှခြင်း (72) ကိုသုံး Rsac.
အလိုလျှင် Rsac အထက်တွက်ချက်သည်ထက်သေးငယ် RSDCယင်းဒီဇိုင်းကိုကျော်လွှားနေဖြင့်ကုန်ပြီ RS2 တစ်ဦးက Capacitor အတူ။ ဆိုတာသတိရပါ Rsac = RS1 နှင့် RSDC = RS1 + RS2။ အခြားတစ်ဖက်တွင် အကယ်. , Rsac ထက်ပိုကြီးတဲ့ဖြစ်ပါသည် RSDC, ထို Q-အမှတ်တစ်ဦးကွဲပြားခြားနားတည်နေရာပြောင်းရွှေ့ရမည်ဖြစ်သည်။ ကျနော်တို့ကသေးငယ်ကို select VDS အရှင်တိုးချဲ့ဗို့အားကိုဖြတ်ပြီးကျဆင်းသွားခံရဖို့ဖြစ်စေတဲ့ RS1 + RS2, အရာစေသည် RSDC ပိုကြီးတဲ့။ အကယ်. VDS အောင်လုံလုံလောက်လောက်လျှော့ချမရနိုင် RSDC ထက်ပိုကြီးတဲ့ Rsacထို့နောက်ချဲ့စက်ကိုပေးထားသောလက်ရှိအမြတ်နှင့်ဒီဇိုင်းမထုတ်လုပ်နိုင်ပါ။ Rinနှင့် FET အမျိုးအစား။ ဤသုံးပါးသတ်မှတ်ချက်များတစ်ခုမှာပြောင်းလဲသွားရဦးမည်, ဒါမှမဟုတ်တစ်စက္ကန့်အသံချဲ့စက်ဇာတ်စင်လိုအပ်သောအမြတ်ပေးဖို့အသုံးပြုရမည်ဖြစ်သည်။
10.3 အဆိုပါ SF Bootstrap Amplifier
ကျနော်တို့အခုအဖြစ်လူသိများသည့် CD ကိုအသံချဲ့စက်တစ်မူကွဲဆနျးစစျ FET အသံချဲ့စက် bootstrap SF (သို့မဟုတ် CD ကို)။ ဤသည်ဆားကစ်ပု SF ၏အထူးကိစ္စတွင်၎င်းဟုခေါ်သည် ဆားကစ် bootstrap နှင့်ပုံ 45 အတွက်သရုပ်ဖော်နေသည်။
ဒီမှာဘက်လိုက်မှုအရင်းအမြစ် resistor သာအစိတ်အပိုင်းတစ်ခုဖြတ်ပြီးဖွံ့ဖြိုးပြီးဖြစ်ပါတယ်။ ဒါဟာအရင်းအမြစ် resistor ၏အစိတ်အပိုင်းကိုဖြတ်ပြီးတစ်ဦးက Capacitor ရှောင်ဘို့လိုအပ်ကြောင်းကိုလျော့နည်းစေခြင်းနှင့်အရှင်ပုံမှန်မှီနိုင်ပါသည်ထက်အများကြီးပိုကြီးတဲ့ input ကိုခုခံပန်းတိုင်လမ်းဆုံးကိုရောက်ခဲ့။ ဒါကဒီဇိုင်းကိုတံခါးဝ resistor ၏မြင့်မားသောတန်ဖိုးကိုသုံးပြီးမရှိဘဲ FET ၏မြင့် impedance ဝိသေသလက္ခဏာများ၏အားသာချက်ယူဖို့ကျွန်တော်တို့ကိုခွင့်ပြု, RG.
ပုံ 46 ၏ညီမျှသော circuit ကိုတိုက်နယ်ခွဲစိတ်အကဲဖြတ်ရန်အသုံးပြုသည်
ကျနော်တို့ကယူဆ iin လက်ရှိထဲမှာဆုံးခနျ့မှနျးဖို့လုံလောက်သေးငယ်သည် RS2 as i1။ အဆိုပါ output ကိုဗို့အားထို့နောက်ဖြစ်တှေ့ရှိရ၏
(75)
ဘယ်မှာ
(76)
ပတ်သက်. ယူဆချက်ပါလျှင် iin မမှန်ကန်တဲ့၊ အသုံးအနှုန်းဖြင့်အစားထိုးသည်
(77)
အဆိုပါ input ကိုအထွက်နှုန်းမှာတစ်ဦးက KVL ညီမျှခြင်း vin အောက်မှာဖော်ပြထားတဲ့အတိုင်း:
(78)
လက်ရှိ, i1တစ်ဦးကလက်ရှိ-Divide ဆက်ဆံရေးမှတွေ့ရှိခဲ့တာဖြစ်ပါတယ်,
(79)
ညီမျှခြင်း (79) နှင့် (78) အထွက်နှုန်းကိုပေါင်းစပ်ပြီး,
(80)
တစ်စက္ကန့်ညီမျှခြင်း vin တဆင့်သည် loop ပတ်ပတ်လည်တီထွင်နေသည် RG နှင့် RS2 အောက်မှာဖော်ပြထားတဲ့အတိုင်း။
(81)
ကျနော်တို့ဖယ်ရှား vin ညီမျှခြင်း (80) ညီမျှညီမျှခြင်း (81) setting အားဖြင့်၎င်း, အဘို့အဖြေရှင်းပေး iin ရရှိရန်
(82)
အဆိုပါ input ကိုခုခံ, Rin = vin/iinအဆိုပါရလဒ်နှင့်အတူညီမျှခြင်း (81) ကညီမျှခြင်း (82) ခွဲဝေတွေ့သည်
(83)
RG , ဒီညီမျှခြင်းအတွက်သာမသိနိုင်ပါဘူးဒါကြောင့်ကျနော်တို့ရရှိရန်ဖြေရှင်းလို့ရပါတယ်
(84)
လက်ရှိအမြတ်ဖြစ်ပါသည်
(85)
ယခုကြှနျုပျတို့သောလေ့လာရေးနှင့်အတူအစောပိုင်းဆင်းသက်လာညီမျှခြင်းကိုသုံးနိုင်သည် RS - RS2 = RS1 လက်ရှိအမြတ်အဘို့အဖြေရှင်းပေးနိုင်ရန်အတွက်။
(86)
အဆိုပါဗို့အမြတ်ဖြစ်ပါသည်
(87)
ညီမျှခြင်း (84) အတွက်ပိုင်းခြေအရှင်ကြောင်းဖေါ်ပြခြင်း, အပိုင်းဝေထက်ပိုကြီးတဲ့ကြောင်းမှတ်ချက် RG <(Rin-RS2) ။ ဒါကကြီးမားတဲ့ input ကိုခုခံအဖြစ်အရွယ်အစား၏တူညီသောအမိန့်မလိုဘဲမှီနိုင်ထေူ RG.