3. 비 반전 증폭기
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비 반전 증폭기
연산 증폭기는 반전 또는 비 반전 출력을 생성하도록 구성 할 수 있습니다. 이전 섹션에서는 반전 증폭기를 분석했습니다. 이제 그림 (5)과 같이 비 반전 증폭기에 대한 분석을 반복합니다.
그림 5- 비 반전 증폭기
이상적인 연산 증폭기의 기본 특성을 사용하여이를 분석합니다. 현재부터 R1 0 인 경우,
(18)
노드 방정식을 v- 노드 수율,
(19)
우리가 설정 한 v+ = v-, 대신에 v- 얻기 위하여,
(20)
비 - 반전 이득은,
(21)
이전 섹션 (“반전 증폭기”)에서 다중 입력 반전 연산 증폭기를 분석했습니다. 이제 다중 입력을 사용하여 비 반전 연산 증폭기를 분석합니다.
그림 6 - 두 개의 비 반전 입력
그림 (6)은 두 개의 입력 전압이있는 회로를 보여줍니다. 찾다 v+, Kirchhoff의 전류 법칙을 비 반전 입력 단자에 적용하여 (연산 증폭기에 대한 입력 전류가 제로임을 상기 시킴)
(22)
그때를 위해 해결 v+, 우리는
(23)
반전 전압, v-의 노드 방정식에서 찾을 수 있습니다. v- 그 결과,
(24)
환경 v+ 동일 v-, 우리는
(25)
신청
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실용적인 의미에서, 효과를 간략하게 고려하는 것이 중요합니다. 로드 연산 증폭기에. 분석에 사용한 방법은 전류가 종속 소스에서 필요하다는 가정을 기반으로 올바른 전압 이득을 산출합니다. 이상 연산 증폭기 모델은 제조업체의 데이터 시트에 명시된 범위 내에 있습니다. 현실 연산 증폭기. 이후 장에서 실제적인 고려 사항을 탐구하지만 다음 두 예제는 개념을 설명합니다.
반전 및 비 반전 구성을 분석 할 때, 연산 증폭기가 부하 저항을 구동하기에 충분한 전류를 공급할 수 있어야합니다.
어플리케이션
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